版图设计工程师-Layout Design Engineer(J20179)

1.关键模块版图设计： 主导Memory存储器关键模块的高密度版图设计，包括高压电路、灵敏放大器、行/列译码器、I/O接口、时序控制逻辑及局部数字控制单元的版图实现； 2.工艺规则执行与验证： 严格执行Memory特定工艺设计规则，完成全流程DRC、LVS及ERC验证，确保版图可制造性与功能一致性； 3.寄生参数优化： 进行寄生参数优化，重点关注位线/字线耦合、高压节点串扰及电源地弹跳对读写精度的影响，通过屏蔽、间距调整及布线层分配等手段提升信号完整性； 4.跨团队协同迭代： 与电路设计工程师紧密协作，根据仿真反馈迭代优化版图，包括匹配、对称性及EM/IR分析； 5.后仿支持与自动化开发： 支持寄生提取与后仿，协助验证团队定位时序或功能问题，参与版图自动化脚本开发，提升重复结构的布局效率。 【任职要求】 1.教育背景与专业知识：本科及以上学历，微电子学与集成电路或半导体器件等相关专业； …… 完整岗位描述与官方投递入口,请登录后在岗位详情页查看。

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