芯片前端设计工程师(J10721)

1、模块级设计、仿真、调试，IP核集成和调试； 2、协助RTL的综合和优化，协助完成timing closure以及formality； 3、支援FPGA原型验证； 4、参与timing violation的分析，与PR工程师一起完成时序收敛。 5、参与完成后端timing收敛、并为后端同事的LAYOUT、封装提供支持。 【任职要求】 1、电子电路相关专业硕士学位； 2、熟悉ASIC前端设计流程，掌握相关的EDA工具； 3、熟悉APB/AHB/AXI规范； 4、能够解决具体的仿真、集成、时序问题； 5、熟悉时序的概念和SDC约束； 6、自我驱动，并具备团队合作精神； 7、加分项一：熟悉图像处理的相关知识； 8、加分项二：熟悉脚本语言Perl和Tcl。

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